JITX

JITX

회로 설계를 코드로 정의하면 AI가 부품 선정부터 PCB 레이아웃까지 전 과정을 자동화하는 하드웨어 설계 플랫폼

부분 무료DesktopVS Code Extension
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소개

JITX는 하드웨어 엔지니어가 Python 코드로 회로 기판을 설계할 수 있는 '소프트웨어 정의 전자장치' 플랫폼입니다. 2025년에는 Python 버전 출시와 함께 신호 무결성에 최적화된 AI 자동 라우터를 선보였으며, AI가 FPGA·메모리 설계 코드 작성부터 SI 제약 설정·시뮬레이션까지 루프를 완성합니다. Sequoia Capital이 주도한 $12M 시리즈 A를 유치했습니다.

활용 워크플로우

입력

Python 기반 하드웨어 설계 코드 (JITX SDK)부품 라이브러리 및 재사용 가능 모듈 (jitxlib)전기적 제약 조건 및 스택업 설정 (SI/PI)실시간 공급망 데이터 (Octopart API)

JITX

코드 기반 회로 컴파일 및 논리 규칙 검증AI 알고리즘을 통한 최적 부품 배치 및 핀 할당제약 조건 준수형 지능형 자동 라우팅 (Constraint-driven)Ansys 연동 신호/전력 무결성(SI/PI) 시뮬레이션 루프

출력

CAD 호환 설계 파일 (Altium, KiCad, Siemens)실시간 재고 반영 BOM 및 제조 데이터 (Gerber)설계 사양 준수 및 DFM 검증 보고서버전 관리 가능한 하드웨어 설계 소스 코드

고속 신호 설계 최적화

DDR5, PCIe Gen4와 같은 고주파 설계 시 임피던스 매칭과 신호 무결성을 AI가 자동 계산하여 반영

공급망 탄력성 워크플로우

설계 중 특정 부품 품절 시, 핀 호환 가능한 대체 부품을 실시간 API로 탐색하여 설계를 자동 업데이트

시스템 레벨 설계 통합

단일 보드를 넘어 다중 보드 간의 상호 연결 및 커넥터 할당을 코드 수준에서 통합 관리

핵심 차별점: PCB 설계를 '그리는' 방식에서 '프로그래밍'하는 소프트웨어 정의 하드웨어(SDH)로 전환하여 설계 오류를 컴파일 단계에서 차단하고 반복 설계 속도를 극대화합니다.

주요 기능

  • Python 코드 기반 PCB 회로도·레이아웃 자동 생성
  • 신호 무결성 최적화 AI 자동 라우터(곡선 경로·차동 쌍 스큐 보정)
  • FPGA·메모리 콤보 설계를 위한 AI 코드 작성 지원
  • SI 제약 조건 자동 설정 및 요구사항→설계→시뮬레이션 루프 완성
  • RF 라우팅 자동화 및 핀 스왑 지원
  • 설계 사이클 최대 25배 가속

장점 & 단점

웹검색을 통해 수집된 사용자 피드백 정보입니다

장점

  • 가장 큰 장점은 설계 효율성과 정확성입니다. 실제 사용자들은 부품 선정부터 핀 할당, 회로도 작성을 코드로 처리함으로써 기존 수작업 대비 설계 속도가 2.5배에서 최대 6배까지 빨라졌다고 평가합니다. 특히 하드웨어 설계를 텍스트(Python)로 관리하므로 소프트웨어 개발처럼 모듈화와 재사용이 가능하며, 컴파일 과정에서 전기적 규칙과 물리적 제약을 실시간으로 검증해 '첫 번째 시도에서의 성공(First-pass success)' 확률을 획기적으로 높여줍니다. 또한 최근 AI LLM을 활용해 하드웨어 설계 코드를 생성하는 기능이 강화되어 생산성이 더욱 높아졌습니다.
  • 기존 수동 방식 대비 설계 속도가 2.5배에서 6배까지 빨라진다고 보고됨
  • 설계가 코드 형태라 Git 워크플로로 팀 협업과 문서화가 원활함
  • 정합성을 엄격히 검사해 누락된 스티칭 비아, 부적절한 디레이팅 등을 자동 포착
  • 파라미터화 회로를 한 번 설계하면 모든 프로젝트에서 재사용 가능
  • 고속 BGA 자동 팬아웃과 60페이지 스케매틱 생성 등 복잡한 설계 처리에 유리
  • 자동 스케매틱 생성, 실시간 설계 규칙 검사, 3D 시각화 기능을 제공함

단점

  • 높은 진입 장벽과 시각적 직관성 부족이 주요 단점입니다. 드래그 앤 드롭 방식에 익숙한 전통적인 하드웨어 엔지니어에게는 파이썬 코딩 능력이 필수적이라는 점이 큰 부담이며, 설계 초기 단계에서 회로의 전체적인 모습을 시각적으로 파악하기 어렵습니다. 또한 복잡한 커스텀 부품의 라이브러리를 직접 코드로 구축하는 초기 설정 비용이 크며, 가격 정책이 주로 록히드 마틴과 같은 대규모 엔터프라이즈 기업에 맞춰져 있어 개인 사용자나 소규모 스타트업이 접근하기에는 비용적 부담과 생태계 규모의 한계가 뚜렷합니다.
  • Stanza 프로그래밍 언어를 새로 학습해야 해 진입 장벽이 상당히 높음
  • GUI가 불안정할 때가 있고 논리 변경은 코드로만 가능해 조작에 제약 있음
  • 전문가용 라이선스가 연간 약 1만 달러로 비엔터프라이즈 사용자에게 부담 큼
  • 판매 목적 사용 시 월 1천 달러 라이선스로 취미 사용자에게 가격 장벽 존재
  • AI 준비 상태나 성숙도에 관한 정보가 제한적이라는 평가가 있음

가격 정보

부분 무료시작 가격: 무료(오픈소스 설계) / 기업용 별도 문의

오픈 소스 설계(CERN OHL)를 위한 무료 플랜을 제공하며, 무제한 설계 복잡도와 자동화 기능을 포함합니다. 기업용 독점 설계(Proprietary Designs)를 위한 유료 플랜은 월 $1,000부터 시작하며, 고급 분석 및 전용 지원 기능이 추가됩니다.

가격표 확인하기

정보 확인일:

활용 사례

  • FPGA·메모리 콤보 복잡 PCB 설계 자동화
  • RF 시스템(위상 배열 안테나 등) 라우팅 자동화
  • 신호 무결성 최적화 고속 PCB 설계
  • 소프트웨어 정의 방식으로 반복 가능한 하드웨어 설계
  • AI가 요구사항부터 제조 가능성 검토까지 일괄 처리

대상 사용자

하드웨어 엔지니어PCB 설계자전자 제품 개발 스타트업FPGA·RF 시스템 개발팀

연동 서비스

Altium DesignerKiCadCadence AllegroSiemens EDA XpeditionGitHubSlackJira

태그

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